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  제목 강사정보 등록일
4 딥러닝 기초 및 설계 김동국/교수/전남대학교 2024.08.09
3 SystemVerilog를 이용한 검증 방법론 이중희 부교수(고려대) 2024.02.14
2 CMOS Analog 전자회로설계 최영식/교수/부경대학교 2018.02.20
1 아나로그 IC 설계 변영재 교수(울산과학기술대학교) 2015.03.17
교육자료
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질문/답변
  제목 작성자 작성일 조회
194 [답변] IC Compiler에서 PnR 후 Virtuoso에 Import 했을때 LVS에러

중간에 어떤 일들을 하셨는지 파일 수정은 어떻게 하셨는지를 정확하게 알지 못하니 ..

선혜승 20.07.17 95
193 [답변] AMS simulation in Cadence (with XCELIUM)

중간에 CIW 창(virtuoso 를 실행하면 처음 뜨는 창)에 설정하는 내용이 있습니다. ex) V..

조인신 20.06.24 4
192 [답변] AMS simulation in Cadence (with XCELIUM)

중간에 CIW 창(virtuoso 를 실행하면 처음 뜨는 창)에 설정하는 내용이 있습니다. ex) V..

박성윤 20.06.24 2
191 [답변] AMS simulation in Cadence (with XCELIUM)

중간에 CIW 창(virtuoso 를 실행하면 처음 뜨는 창)에 설정하는 내용이 있습니다. ex) V..

조인신 20.06.24 2
190 [답변] AMS simulation in Cadence (with XCELIUM)

중간에 CIW 창(virtuoso 를 실행하면 처음 뜨는 창)에 설정하는 내용이 있습니다. ex) V..

박성윤 20.06.24 2
189 [답변] AMS simulation in Cadence (with XCELIUM)

중간에 CIW 창(virtuoso 를 실행하면 처음 뜨는 창)에 설정하는 내용이 있습니다. ex) V..

조인신 20.06.24 6
188 [답변] AMS simulation in Cadence (with XCELIUM)

중간에 CIW 창(virtuoso 를 실행하면 처음 뜨는 창)에 설정하는 내용이 있습니다. ex) V..

박성윤 20.06.24 3
187 [답변] AMS simulation in Cadence (with XCELIUM)

중간에 CIW 창(virtuoso 를 실행하면 처음 뜨는 창)에 설정하는 내용이 있습니다. ex) V..

조인신 20.06.24 8
186 [답변] AMS simulation in Cadence (with XCELIUM)

중간에 CIW 창(virtuoso 를 실행하면 처음 뜨는 창)에 설정하는 내용이 있습니다. ex) V..

박성윤 20.06.25 40
185 DRC 문의

중간보고서 양식은 따로 없고 자유롭게 기술하면 될까요?

안정모 20.06.22 37
184 [답변] DRC 문의

중간보고서 양식은 따로 없고 자유롭게 기술하면 될까요?

조인신 20.06.22 41
183 S65nm low memory 관련

중간에 강제종료가 됩니다.   Log 파일을 확인해 보니 첨부된 파일과 같이 하드웨..

고성민 20.06.17 19
182 [답변] S65nm low memory 관련

중간에 강제종료가 됩니다.   Log 파일을 확인해 보니 첨부된 파일과 같이 하드웨..

선혜승 20.06.17 14
181 [답변] S65nm low memory 관련

중간에 강제종료가 됩니다.   Log 파일을 확인해 보니 첨부된 파일과 같이 하드웨..

고성민 20.06.17 9
180 [답변] S65nm low memory 관련

중간에 강제종료가 됩니다.   Log 파일을 확인해 보니 첨부된 파일과 같이 하드웨..

선혜승 20.06.19 38
179 [답변] TCAD sentaurus TCP 관련 질문 드립니다.

중간중간에 터미널 창에서 echo 3 > /proc/sys/vm/drop_caches 엔터 해서 메모리를&..

조인신 20.05.13 4
178 [답변] TCAD sentaurus TCP 관련 질문 드립니다.

중간중간에 터미널 창에서 echo 3 > /proc/sys/vm/drop_caches 엔터 해서 메모리를&..

염민재 20.05.13 8
177 [답변] TCAD sentaurus TCP 관련 질문 드립니다.

중간중간에 터미널 창에서 echo 3 > /proc/sys/vm/drop_caches 엔터 해서 메모리를&..

조인신 20.05.13 6
176 [답변] TCAD sentaurus TCP 관련 질문 드립니다.

중간중간에 터미널 창에서 echo 3 > /proc/sys/vm/drop_caches 엔터 해서 메모리를&..

염민재 20.05.13 5
175 [답변] TCAD sentaurus TCP 관련 질문 드립니다.

중간중간에 터미널 창에서 echo 3 > /proc/sys/vm/drop_caches 엔터 해서 메모리를&..

조인신 20.05.14 4
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자료실
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2 e2l-디지털시스템-논리회로 설계 및 실험

중간평가• 제9주Number system과 이진 덧셈기에 대하여 공부하고 여러 가지 덧셈기..

구재희 05.01.05 1078
1 e2l-디지털시스템-FIFO를 이용한 온도 감지 시스템 설계/직렬 통신을 이용한 FPGA ..

중간발표, 최종발표 등을 통하여 철저하게 관리하여 학점으로 연관시켜 교육한다. 키워..

구재희 04.12.30 1005
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MPW공지사항 SF28-2402 회차 DB 제출 현황(02.14)

중간에 gds 파일을 변경한 팀, 서버 이슈로 업로드가 지연된 팀은 잘 확인 하시기 바랍니..

김연태 25.02.14 221
MPW공지사항 [SB130-2401] DB 제출 프로그램 오류 수정 및 마감일 연장 안내 (11.10 ..

중간에 DB 수정 역시 불가 합니다.    11월 10일 오전 9시까지 반드시 제출..

김연태 24.11.08 84
MPW공지사항 [SF28-2401] DB 제출 현황 (기준 : 24.09.23)

중간에 DK 변경 시 저에게 꼭 알려 주셔야 합니다.  - 패키지 신청팀은 칩코드 ..

김연태 24.09.09 1704
참여교수 성과 - 특허 반도체 테스트 방법 및 이를 이용한 장치

중간 명령어를 생성 및 제2 사이클 내의 입력 명령어들을 연산하여 제2 중간 명령어를 생..

강성호 24.02.23 5
참여교수 성과 - 특허 자연 산화막을 이용하여 중간층을 형성하는 터널링 소자 제작 방법

중간층을 형성하는 터널링 소자 제작 방법

유현용 23.02.16 1
참여교수 성과 - 특허 자연 산화막을 이용하여 중간층을 형성하는 터널링 소자 제작 방법

중간층을 형성하는 터널링 소자 제작 방법

유현용 23.02.16 1
참여교수 성과 - 특허 NAND 플래시 메모리와 SRAM이 융합된 NAS 메모리 셀 및 이를 이용한 NAS ..

중간과정도 거치지 않고, 선택된 모든 행에 대하여 한 번에 NAND Flash 스트링에서 SRAM ..

김윤 22.02.11 5
참여교수 성과 - 특허 자연 산화막을 이용하여 중간층을 형성하는 터널링 소자 제작 방법

중간층을 형성하는 터널링 소자 제작 방법(2021.02.26)

유현용 22.02.10 9
개설 희망 강좌 신청 [ 캠퍼스][답변] 집적회로 설계 기초 및 저전력 설계 기법 증원부탁드립..

중간에 수강취소로 여석이 발생하는 경우가 왕왕 있으니 추이를 지켜봐 주시기 바랍니다..

박수견 22.02.07 1281
개설 희망 강좌 신청 [ 캠퍼스][답변] 집적회로 설계 기초 및 저전력 설계 기법 증원 희망합니..

중간에 수강취소로 여석이 발생하는 경우가 왕왕 있으니 추이를 지켜봐 주시기 바랍니다..

박수견 22.02.07 1225
개설 희망 강좌 신청 [ 캠퍼스][답변] 집적회로 설계 기초 및 저전력 설계 기법 증원 요청합니..

중간에 수강취소로 여석이 발생하는 경우가 왕왕 있으니 추이를 지켜봐 주시기 바랍니다..

박수견 22.02.07 1231
참여교수 성과 - 특허 주입 동기 링 발진기 기반의 저전력 FSK 복조 장치 및 방법

중간 주파수(intermediate frequency, IF)를 이용하는 GFSK(Ga..

이정협 21.02.18 6
참여교수 성과 - 논문 금속층-중간층-반도체 소스/드레인 구조를 이용한 Enhancement mode n타..

유현용 17.10.27 2
참여교수 성과 - 특허 음의 고정전하 밀도 제어가 가능한 단결정 실리콘 태양전지의 패시베이션..

중간층으로서 산화아연 박막을 형성하는 단계를 포함하고, 상기 산화아연 박막의 두께를 ..

이가원 14.09.22 7
공지사항 2015년 정기 EDA Tool 수요조사 배분수량 공지 안내

중간의 “IDEC 참여내역”      -> “EDA Tool 신청내역”..

석은주 15.02.24 9769
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