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캠퍼스 경북대-아카데미 구분 설계강좌 / Digital / 초중급 / 이론+실습 마감
강의제목 RTL-to-GDSII 실무를 위한 디지털 집적회로 이론 및 설계
강의일자 2023-04-17 ~ 2023-04-18 신청 및 취소기간 재직자 : 2023-04-05 00:00 ~ 2023-04-11 23:59
전  체  : 2023-04-12 00:00 ~ 2023-04-13 23:59
강의형태 대면 신청현황 22/30명
수강료(일반) 무료 수강료(학생) 무료
수강대상 디지털회로설계 전반에 대한 지식을 희망하는 산업체 연구원
사전지식
선수과목
논리회로, MOSFET 구조 및 동작원리, Linux 사용법(권장)
강의목표

본 강좌에서는 다음의 내용을 다루게 되며, 그에 해당하는 tool을 능숙하게 사용하는 것을 그 목표로 합니다.
- Digital VLSI 설계 개론
- Standard Cell과 interconnect의 이해 (Custom Compiler)
- RTL과 논리합성 (Design compiler, VCS)
- 제작 가능한 Layout 설계 (DRC/LVS, IC Validator)
- Placement and Routing (P&R, IC Compiler II)
- Sign-off 기생성분 추출과 STA (StarRC, PrimeTime)

강의개요

본 강좌는 반도체 (IC) 설계의 여러 단계 중 '물리적 설계 (physical design)'를 하는 방법을 다룹니다. 물리적 설계란, 디지털 IC를 설계하는 기본적인 구성요소인 논리 게이트 (standard cell), 및 메모리 (SRAM)를 직접 실리콘 칩에 배치하고 연결하는 매우 중요한 과정입니다. 본 강좌에서는 논리적 설계에서 HDL로 디지털 회로의 코딩이 완료되면 (RTL), 이를 바탕으로 논리 게이트로 합성 (synthesis) 후 직접 배치 및 연결 (place & route) 하여 최종 분석 (sign-off) 하는 일련의 과정을 배우게 됩니다. 본 수업은 Synopsys 사의 tool들을 이용하여 이 모든 과정을 직접 실습하게 될 것이며, RTL에서 최종 물리설계의 결과물인 GDSII를 (RTL-to-GDSII) 추출하는 과정을 실습하는 것을 통해 반도체 산업 현장에 바로 투입할 수 있는 기술을 배우는 것을 그 목표로 합니다.

참고사항

♦ 수강신청 마감시 수강 원하시는 재직자분들은 따로 연락 바랍니다!!
♦ 출석 100%, 퀴즈 3/5문제 통과시 수료증이 발급됩니다.
♦ 수강신청 기간 내에 홈페이지에서 수강 취소해야 정상 취소처리 됩니다.
♦ 1개 교육에 대해 전일 결석시, 추후 3개월간 수강신청이 자동차단됩니다. (취소는 홈페이지에서 직접 가능)

강좌상세
일자 2023-04-17 시간 10:00 ~ 12:00 강사 송대건 조교수 경북대학교
내용 ○ Introduction 및 RTL-to-GDSII flow 소개
일자 2023-04-17 시간 13:00 ~ 17:30 강사 송대건 조교수 경북대학교
내용 ○ RTL, Logic Synthesis
일자 2023-04-18 시간 10:00 ~ 12:00 강사 송대건 조교수 경북대학교
내용 ○ Physical Design I
일자 2023-04-18 시간 13:00 ~ 17:30 강사 송대건 조교수 경북대학교
내용 ○ Physical Design II, Sign-off analysis
강의장소

경북대 IT대학 2호관 206호

담당자 연락처
  • 경북대-아카데미 담당자 : 김지영
  • 연락처 : 053-950-6858
  • 이메일 : idec@knu.ac.kr

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